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  • Ejercicios Logica Combinacional

    Cargado por

    Rodolfo Herrera
    164 vistas4 páginas
    Este documento trata sobre lógica combinacional. 1) Presenta una tabla de verdad y deduce la salida lógica de un circuito. 2) Simplifica funciones booleanas usando álgebra booleana. 3) Usa mapas de Karnaugh para simplificar funciones. 4) Obtiene el complemento de una función. 5-6) Analiza un circuito combinacional con entradas de selección y multiplexor. 7) Diseña un codificador de 4 líneas a código de exceso 3.

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    Este documento trata sobre lógica combinacional. 1) Presenta una tabla de verdad y deduce la salida lógica de un circuito. 2) Simplifica funciones booleanas usando álgebra booleana. 3) Usa mapas de Karnaugh para simplificar funciones. 4) Obtiene el complemento de una función. 5-6) Analiza un circuito combinacional con entradas de selección y multiplexor. 7) Diseña un codificador de 4 líneas a código de exceso 3.

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    Lógica Combinacional

    1.- ¿Cuál es la salida Booleana del siguiente circuito? A B C S


    Escribir además una 0 0 1 1
    Tabla de Verdad para el mismo.
    0 1 0 1
    0 1 1 1
    1 0 0 1
    1 0 1 1
    1 1 0 0
    1 1 1 0
    2.- Simplifica las siguientes funciones por algebra booleana

    a) F = xy´z + x´z´+ yz´+ x

    F= x+xy’z+x’z’+yz’

    F= x+x’z’+yz’

    F= x+z’+yz’

    F= x+z’+z’y

    z’+z’y= z’

    F= x+z’

    b) F = x´y´z + xyz +y +yz´+ x´z

    y+yxz= y

    F= x’y’z’+y+yz’+x’z

    F= y+x’z’+yz’+x’z

    F= y+yz’+x’z’+x’z

    F= y+x’z’+x’z

    F= y+x’z’+x’z’

    X’z+x’z’= x’

    F= y+x’
    3.- Utilizando los mapas de Karnaugh, simplificar las siguientes funciones

    a) F(x,y,z) = ∑m 2,3,4,5,6,7

    (X’Y’)

    c) F (w,x,y,z) = ∑m 3.6,7,11,12,14,15

    (Y+Z’)(W+Y)(X+Z)

    4.- Aplicando las leyes de Morgan, obtener el complemento de la siguiente función F =

    (X+Y) (YZ+XY)
    5.- Un circuito combinacional consta de dos entradas de datos A y B, dos entradas de selección de
    operación S1 y S0 y una salida Y de un solo bit. Funciona del siguiente modo con las señales S1 y
    S0, puede seleccionarse la función lógica Y, según la siguiente tabla:

    Se pide: a) La tabla de verdad. b) La función lógica simplificada mediante Karnaugh.

    A B S1 S0 Y A B S1 S0 Y

    0 0 0 0 0 1 0 0 0 1

    0 0 0 1 0 1 0 0 1 0

    0 0 1 0 1 1 0 1 0 0

    0 0 1 1 1 1 0 1 1 1

    0 1 0 0 1 1 1 0 0 0

    0 1 0 1 0 1 1 0 1 1

    0 1 1 0 1 1 1 1 0 0

    0 1 1 1 0 1 1 1 1 0

    B)
    S1S0/AB 00 01 11 10
    00 1 1
    01 1
    11 1 1
    10 1 1

    6.- Empleando un multiplexor de ocho entradas de información y tres de selección, implementar el


    circuito lógico que responda a la función lógica:

    F = ∑m 1,3,4,6,9,10,13,14

    F=A’BC’D+A’B’CD+A’BCD’+A’BCD+A’BC’D+A’BC’D’+AB’CD+AB’C’D+ABCD’

    A/BCD 000 001 010 011 100 101 110 111

    0 0 1 0 1 1 1 1 1

    1 0 1 0 1 0 0 1 0
    7.- Diseñar y montar mediante puertas lógicas un codificador de 4 líneas a código exceso 3.

    S0=0
    S1=A1+A2+A3
    S2=A0+A3
    S3=A0+A2

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